dComArk15/Aflevering1-Paritetsfunktionen/Afl1_XOR.circ

160 lines
5.0 KiB
Plaintext
Raw Normal View History

2016-01-03 12:29:05 +00:00
<?xml version="1.0" encoding="UTF-8" standalone="no"?>
<project source="2.7.1" version="1.0">
This file is intended to be loaded by Logisim (http://www.cburch.com/logisim/).
<lib desc="#Wiring" name="0"/>
<lib desc="#Gates" name="1">
<tool name="AND Gate">
<a name="inputs" val="2"/>
</tool>
<tool name="OR Gate">
<a name="inputs" val="2"/>
</tool>
<tool name="XOR Gate">
<a name="inputs" val="2"/>
</tool>
</lib>
<lib desc="#Plexers" name="2"/>
<lib desc="#Arithmetic" name="3"/>
<lib desc="#Memory" name="4">
<tool name="ROM">
<a name="contents">addr/data: 8 8
0
</a>
</tool>
</lib>
<lib desc="#I/O" name="5"/>
<lib desc="#Base" name="6">
<tool name="Text Tool">
<a name="text" val=""/>
<a name="font" val="SansSerif plain 12"/>
<a name="halign" val="center"/>
<a name="valign" val="base"/>
</tool>
</lib>
<main name="main"/>
<options>
<a name="gateUndefined" val="ignore"/>
<a name="simlimit" val="1000"/>
<a name="simrand" val="0"/>
</options>
<mappings>
<tool lib="6" map="Button2" name="Menu Tool"/>
<tool lib="6" map="Button3" name="Menu Tool"/>
<tool lib="6" map="Ctrl Button1" name="Menu Tool"/>
</mappings>
<toolbar>
<tool lib="6" name="Poke Tool"/>
<tool lib="6" name="Edit Tool"/>
<tool lib="6" name="Text Tool">
<a name="text" val=""/>
<a name="font" val="SansSerif plain 12"/>
<a name="halign" val="center"/>
<a name="valign" val="base"/>
</tool>
<sep/>
<tool lib="0" name="Pin">
<a name="tristate" val="false"/>
</tool>
<tool lib="0" name="Pin">
<a name="facing" val="west"/>
<a name="output" val="true"/>
<a name="labelloc" val="east"/>
</tool>
<tool lib="1" name="NOT Gate"/>
<tool lib="1" name="AND Gate"/>
<tool lib="1" name="OR Gate"/>
</toolbar>
<circuit name="main">
<a name="circuit" val="main"/>
<a name="clabel" val=""/>
<a name="clabelup" val="east"/>
<a name="clabelfont" val="SansSerif plain 12"/>
<wire from="(290,100)" to="(300,100)"/>
<wire from="(90,160)" to="(150,160)"/>
<wire from="(90,120)" to="(150,120)"/>
<wire from="(210,140)" to="(220,140)"/>
<wire from="(300,100)" to="(310,100)"/>
<wire from="(220,120)" to="(240,120)"/>
<wire from="(210,60)" to="(220,60)"/>
<wire from="(90,80)" to="(150,80)"/>
<wire from="(90,40)" to="(150,40)"/>
<wire from="(220,80)" to="(240,80)"/>
<wire from="(220,60)" to="(220,80)"/>
<wire from="(220,120)" to="(220,140)"/>
<comp lib="0" loc="(90,160)" name="Pin">
<a name="tristate" val="false"/>
<a name="label" val="D"/>
</comp>
<comp lib="0" loc="(90,40)" name="Pin">
<a name="tristate" val="false"/>
<a name="label" val="A"/>
</comp>
<comp lib="1" loc="(300,100)" name="XOR Gate">
<a name="inputs" val="2"/>
</comp>
<comp lib="1" loc="(210,140)" name="XOR Gate">
<a name="inputs" val="2"/>
</comp>
<comp lib="1" loc="(210,60)" name="XOR Gate">
<a name="inputs" val="2"/>
</comp>
<comp lib="0" loc="(90,80)" name="Pin">
<a name="tristate" val="false"/>
<a name="label" val="B"/>
</comp>
<comp lib="0" loc="(310,100)" name="Pin">
<a name="facing" val="west"/>
<a name="output" val="true"/>
<a name="label" val="P"/>
<a name="labelloc" val="north"/>
</comp>
<comp lib="0" loc="(90,120)" name="Pin">
<a name="tristate" val="false"/>
<a name="label" val="C"/>
</comp>
</circuit>
<circuit name="main2">
<a name="circuit" val="main2"/>
<a name="clabel" val=""/>
<a name="clabelup" val="east"/>
<a name="clabelfont" val="SansSerif plain 12"/>
<wire from="(120,80)" to="(120,90)"/>
<wire from="(50,30)" to="(130,30)"/>
<wire from="(130,90)" to="(150,90)"/>
<wire from="(210,70)" to="(230,70)"/>
<wire from="(130,30)" to="(130,50)"/>
<wire from="(130,50)" to="(150,50)"/>
<wire from="(120,80)" to="(150,80)"/>
<wire from="(50,90)" to="(120,90)"/>
<wire from="(130,90)" to="(130,120)"/>
<wire from="(50,60)" to="(150,60)"/>
<wire from="(50,120)" to="(130,120)"/>
<comp lib="0" loc="(50,30)" name="Pin">
<a name="tristate" val="false"/>
<a name="label" val="A"/>
</comp>
<comp lib="0" loc="(50,120)" name="Pin">
<a name="tristate" val="false"/>
<a name="label" val="D"/>
</comp>
<comp lib="0" loc="(50,90)" name="Pin">
<a name="tristate" val="false"/>
<a name="label" val="C"/>
</comp>
<comp lib="0" loc="(50,60)" name="Pin">
<a name="tristate" val="false"/>
<a name="label" val="B"/>
</comp>
<comp lib="0" loc="(230,70)" name="Pin">
<a name="facing" val="west"/>
<a name="output" val="true"/>
<a name="label" val="P"/>
<a name="labelloc" val="north"/>
</comp>
<comp lib="1" loc="(210,70)" name="XOR Gate">
<a name="inputs" val="4"/>
<a name="xor" val="odd"/>
</comp>
</circuit>
</project>